Accurate estimation of global buffer delay within a floorplan

  1. Alpert, C.J.
  2. Hu, J.
  3. Sapatnekar, S.S.
  4. Sze, C.N.
Revista:
IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems

ISSN: 0278-0070

Año de publicación: 2006

Volumen: 25

Número: 6

Páginas: 1140-1146

Tipo: Artículo

DOI: 10.1109/TCAD.2005.855889 GOOGLE SCHOLAR

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