Layout-aware design methodology for a 75 GHz power amplifier in a 55 nm SiGe technology

  1. Del Rio, D.
  2. Gurutzeaga, I.
  3. Solar, H.
  4. Beriain, A.
  5. Berenguer, R.
Revista:
Integration, the VLSI Journal

ISSN: 0167-9260

Ano de publicación: 2016

Volume: 52

Páxinas: 208-216

Tipo: Artigo

DOI: 10.1016/J.VLSI.2015.07.010 GOOGLE SCHOLAR

Obxectivos de Desenvolvemento Sustentable

Fonte de datos: Scopus