Layout-aware design methodology for a 75 GHz power amplifier in a 55 nm SiGe technology

  1. Del Rio, D.
  2. Gurutzeaga, I.
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  4. Beriain, A.
  5. Berenguer, R.
Revista:
Integration, the VLSI Journal

ISSN: 0167-9260

Año de publicación: 2016

Volumen: 52

Páginas: 208-216

Tipo: Artículo

DOI: 10.1016/J.VLSI.2015.07.010 GOOGLE SCHOLAR
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